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MathWorks HDL ta工具新添Xilinx FPGA 硬件验证功能

MathWorks日前宣布适用于XilinxFPGA开发板且新添了FPGA在环(FIL)功能的EDASimulatorLink3.3面市。FIL使工程师们能够在使用Simulink作为系统级测试台架的同时,以硬件速度验证其设计。

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EDASimulatorLink支持HDL验证选项全集使用在MATLAB和Simulink中创建的算法,而FIL的引入则进一步补充了这一全集。基于FPGA的验证不仅提供了比HDL仿真器高得多的运行时性能,而且增强了算法的实际应用效果。

主要的产品功能包括以下能力:

•使用适用于Spartan和Virtex类设备的FPGA开发板(包括Virtex-6ML605开发板),验证MATLAB代码和Simulink模型的HDL实现。

•使用MentorGraphicsModelSim、MentorGraphicsQuesta和CadenceDesignSystemsIncisiveEnterpriseSimulator的协同仿真,验证MATLAB代码和Simulink模型的HDL实现

•生成适用于SystemC虚拟原型环境的TLM2.0组件。

图注:

EDASimulatorLink为XilinxVirtex6和Spartan6FPGA开发板提供了FIL仿真支持

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